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符合PCIe5.0和CXL2.0双标准，新思科技创新DesignWare IDE安全IP核为高性能计算SoC设计保驾护航

新思科技 · 公众号 · · 2021-02-23 10:00

正文

DesignWare完整性和数据加密安全模块为使用PCI Express®5.0或CXL™ 2.0架构的SoC提供数据传输的保护

通过预先验证过的面向PCI Express技术和CXL的DesignWare控制IP核，促使快速集成并降低风险

通过AES-GCM进行高效加密、解密和身份验证，有助于确保高性能系统的数据机密性和完整性

新思科技（Synopsys）近日宣布，提供DesignWare®完整性和数据加密（IDE）安全模块以使用PCI Express®（PCIe®）5.0架构或Compute Express Link™（CXL™）2.0接口帮助设计人员防范高性能计算（HPC）SoC中的数据篡改和物理攻击。DesignWare IDE安全模块通过基于AES-GCM算法的高效加密、解密和身份验证方式来保护敏感数据，同时满足PCIe 5.0规范和CXL 2.0 IP核的性能和延迟要求。DesignWare IDE安全模块按照最新的PCIe 5.0规范和CXL 2.0接口标准设计，并使用新思科技的DesignWare控制器IP核进行设计和验证，以加速SoC集成。

“PCIe 5.0规范中的IDE加密功能与行业标准设计要求一致，可以随着安全需求的演变灵活扩展，通过为PCIe 5.0规范提供接口和安全IP核的独特组合，新思科技能够让设计者在他们的系统中快速实现必要的安全功能。”

——Al Yanes

主席兼总裁

PCI-SIG®

“安全是所有技术成功的基石，将IDE安全功能添加到CXL 2.0规范中可以支持创建更安全的生态系统。作为CXL 联盟的成员，我们很高兴能够得到新思科技的支持，从而帮助设计人员将安全功能集成到先进的云服务和高性能计算系统中。”

——Jim Pappas

联盟主席

CXL

“随着超大规模云数据中心内互联网流量的巨量增长，安全对于保护这些系统中的数据传输变得至关重要。新思科技的创新DesignWare IDE安全IP核模块与我们面向PCIe 5.0技术和CXL 2.0的DesignWare控制器相结合，使设计人员能够在芯片级别集成符合标准的安全功能，从而大大降低风险。”

——John Koeter

IP核营销和战略高级副总裁

新思科技

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