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符合PCIe5.0和CXL2.0双标准，新思科技创新DesignWare IDE安全IP核为高性能计算SoC设计保驾护航

新思科技 · 公众号 · · 2021-02-23 10:00

正文

DesignWare完整性和数据加密安全模块为使用PCI Express®5.0或CXL™ 2.0架构的SoC提供数据传输的保护

通过预先验证过的面向PCI Express技术和CXL的DesignWare控制IP核，促使快速集成并降低风险

通过AES-GCM进行高效加密、解密和身份验证，有助于确保高性能系统的数据机密性和完整性

新思科技（Synopsys）近日宣布，提供DesignWare®完整性和数据加密（IDE）安全模块以使用PCI Express®（PCIe®）5.0架构或Compute Express Link™（CXL™）2.0接口帮助设计人员防范高性能计算（HPC）SoC中的数据篡改和物理攻击。DesignWare IDE安全模块通过基于AES-GCM算法的高效加密、解密和身份验证方式来保护敏感数据，同时满足PCIe 5.0规范和CXL 2.0 IP核的性能和延迟要求。DesignWare IDE安全模块按照最新的PCIe 5.0规范和CXL 2.0接口标准设计，并使用新思科技的DesignWare控制器IP核进行设计和验证，以加速SoC集成。